change: naming problem
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otroubi
@ -12,11 +12,11 @@ module sampler
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||||
input [DATA_WIDTH-1:0] data_in,
|
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input out_of_range,
|
||||
input [31:0] smp_num,
|
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input done,
|
||||
input request,
|
||||
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||||
output logic [DATA_WIDTH*PACK_FACTOR-1:0] m_axis_tdata,
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||||
output logic m_axis_tvalid,
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||||
output logic request
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||||
output logic done
|
||||
);
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||||
(* MARK_DEBUG="true" *) logic [DATA_WIDTH-1:0] data_converted;
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||||
(* MARK_DEBUG="true" *) logic out_of_range_reg;
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||||
@ -74,11 +74,11 @@ module sampler
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||||
if (!enable) begin
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||||
if (request && done) begin
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enable <= 1;
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request <= 0;
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done <= 0;
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cnt_smp_num <= 0;
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||||
smp_num_reg <= smp_num;
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||||
end else begin
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request <= 1;
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done <= 1;
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||||
end
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||||
end else begin
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||||
if (cnt_smp_num != smp_num_reg) begin
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||||
@ -112,11 +112,11 @@ module sampler
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||||
if (!enable) begin
|
||||
if (request && done) begin
|
||||
enable <= 1;
|
||||
request <= 0;
|
||||
done <= 0;
|
||||
cnt_smp_num <= 0;
|
||||
smp_num_reg <= smp_num;
|
||||
end else begin
|
||||
request <= 1;
|
||||
done <= 1;
|
||||
end
|
||||
end else begin
|
||||
if (cnt_smp_num != smp_num_reg) begin
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||||
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||||
346
rtl/sampler/tests/sampler_tb.sv
Normal file
346
rtl/sampler/tests/sampler_tb.sv
Normal file
@ -0,0 +1,346 @@
|
||||
`timescale 1ns / 1ps
|
||||
|
||||
module sampler_tb;
|
||||
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||||
localparam DATA_WIDTH = 12;
|
||||
localparam PACK_FACTOR = 1;
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||||
localparam PROCESS_MODE = 0;
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localparam CLK_PERIOD = 15.3846;
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// =====================================================
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// DUT SIGNALS
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// =====================================================
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logic clk;
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logic rst;
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logic [DATA_WIDTH-1:0] data_in;
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||||
logic out_of_range;
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||||
logic [31:0] smp_num;
|
||||
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logic done;
|
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logic request;
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||||
logic [DATA_WIDTH*PACK_FACTOR-1:0] m_axis_tdata;
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||||
logic m_axis_tvalid;
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||||
// =====================================================
|
||||
// SCOREBOARD
|
||||
// =====================================================
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||||
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||||
int received_count;
|
||||
int expected_count;
|
||||
|
||||
// =====================================================
|
||||
// DUT
|
||||
// =====================================================
|
||||
|
||||
sampler #(
|
||||
.DATA_WIDTH (DATA_WIDTH),
|
||||
.PACK_FACTOR (PACK_FACTOR),
|
||||
.PROCESS_MODE(PROCESS_MODE)
|
||||
) dut (
|
||||
.clk_in (clk),
|
||||
.rst (rst),
|
||||
|
||||
.data_in (data_in),
|
||||
.out_of_range (out_of_range),
|
||||
|
||||
.smp_num (smp_num),
|
||||
.done (request),
|
||||
|
||||
.m_axis_tdata (m_axis_tdata),
|
||||
.m_axis_tvalid(m_axis_tvalid),
|
||||
|
||||
.request (done)
|
||||
);
|
||||
|
||||
// =====================================================
|
||||
// CLOCK
|
||||
// =====================================================
|
||||
|
||||
initial begin
|
||||
clk = 0;
|
||||
forever #(CLK_PERIOD/2) clk = ~clk;
|
||||
end
|
||||
|
||||
// =====================================================
|
||||
// RESET
|
||||
// =====================================================
|
||||
|
||||
initial begin
|
||||
rst = 1;
|
||||
|
||||
data_in = 0;
|
||||
out_of_range = 0;
|
||||
|
||||
done = 0;
|
||||
smp_num = 0;
|
||||
|
||||
repeat(5) @(posedge clk);
|
||||
|
||||
rst = 0;
|
||||
end
|
||||
|
||||
// =====================================================
|
||||
// RECEIVED COUNTER
|
||||
// =====================================================
|
||||
|
||||
always @(posedge clk) begin
|
||||
if (m_axis_tvalid)
|
||||
received_count++;
|
||||
end
|
||||
|
||||
// =====================================================
|
||||
// CONFIG
|
||||
// =====================================================
|
||||
|
||||
task automatic set_config(input int n);
|
||||
begin
|
||||
smp_num = n;
|
||||
@(posedge clk);
|
||||
end
|
||||
endtask
|
||||
|
||||
// =====================================================
|
||||
// WAIT SAMPLER START
|
||||
// =====================================================
|
||||
|
||||
task automatic wait_sampler_start;
|
||||
begin
|
||||
wait(dut.enable == 1'b1);
|
||||
// @(negedge clk);
|
||||
end
|
||||
endtask
|
||||
|
||||
// =====================================================
|
||||
// HANDSHAKE
|
||||
// =====================================================
|
||||
|
||||
task automatic synchronize_sampler(
|
||||
input bit sampler_first,
|
||||
input int delay_before_ack,
|
||||
input int ack_duration
|
||||
);
|
||||
begin
|
||||
|
||||
if (sampler_first) begin
|
||||
|
||||
repeat(delay_before_ack)
|
||||
@(posedge clk);
|
||||
|
||||
done <= 1'b1;
|
||||
|
||||
wait(request == 1'b1);
|
||||
|
||||
repeat(ack_duration)
|
||||
@(posedge clk);
|
||||
|
||||
done <= 1'b0;
|
||||
|
||||
end
|
||||
else begin
|
||||
|
||||
wait(request == 1'b1);
|
||||
|
||||
repeat(delay_before_ack)
|
||||
@(posedge clk);
|
||||
|
||||
done <= 1'b1;
|
||||
|
||||
repeat(ack_duration)
|
||||
@(posedge clk);
|
||||
|
||||
done <= 1'b0;
|
||||
|
||||
end
|
||||
|
||||
end
|
||||
endtask
|
||||
|
||||
// =====================================================
|
||||
// DATA FEED
|
||||
// =====================================================
|
||||
|
||||
task automatic feed_data_stream(
|
||||
input int num_words,
|
||||
input bit random_data,
|
||||
input bit random_out_of_range
|
||||
);
|
||||
|
||||
logic [DATA_WIDTH-1:0] value;
|
||||
bit oor;
|
||||
|
||||
begin
|
||||
|
||||
value = 1;
|
||||
|
||||
for (int i = 0; i < num_words; i++) begin
|
||||
|
||||
if (random_data)
|
||||
value = $urandom_range(1, (1<<DATA_WIDTH)-1);
|
||||
else
|
||||
value = value + 1;
|
||||
|
||||
if (random_out_of_range)
|
||||
oor = ($urandom_range(0,3) == 0);
|
||||
else
|
||||
oor = 0;
|
||||
|
||||
|
||||
data_in = value;
|
||||
out_of_range = oor;
|
||||
|
||||
|
||||
if (!oor)
|
||||
expected_count++;
|
||||
|
||||
@(posedge clk);
|
||||
|
||||
end
|
||||
|
||||
out_of_range <= 0;
|
||||
|
||||
end
|
||||
endtask
|
||||
|
||||
// =====================================================
|
||||
// SINGLE TEST
|
||||
// =====================================================
|
||||
|
||||
task automatic run_test_case(
|
||||
input int n,
|
||||
input int delay_before_ack,
|
||||
input int ack_duration,
|
||||
input bit sampler_first,
|
||||
input bit random_data,
|
||||
input bit random_out_of_range
|
||||
);
|
||||
begin
|
||||
|
||||
received_count = 0;
|
||||
expected_count = 0;
|
||||
|
||||
data_in = 0;
|
||||
out_of_range = 0;
|
||||
done = 0;
|
||||
|
||||
set_config(n);
|
||||
|
||||
synchronize_sampler(
|
||||
sampler_first,
|
||||
delay_before_ack,
|
||||
1
|
||||
);
|
||||
|
||||
|
||||
feed_data_stream(
|
||||
n,
|
||||
random_data,
|
||||
random_out_of_range
|
||||
);
|
||||
|
||||
repeat(30)
|
||||
@(posedge clk);
|
||||
|
||||
$display(
|
||||
"Expected=%0d Received=%0d",
|
||||
expected_count,
|
||||
received_count
|
||||
);
|
||||
|
||||
if (received_count == expected_count)
|
||||
$display("[OK]");
|
||||
else
|
||||
$display("[ERROR]");
|
||||
|
||||
repeat(10)
|
||||
@(posedge clk);
|
||||
|
||||
end
|
||||
endtask
|
||||
|
||||
// =====================================================
|
||||
// RANDOM STRESS
|
||||
// =====================================================
|
||||
|
||||
task automatic random_stress_test;
|
||||
int n;
|
||||
int d;
|
||||
int a;
|
||||
bit sf;
|
||||
begin
|
||||
|
||||
for (int i = 0; i < 20; i++) begin
|
||||
|
||||
n = $urandom_range(5,20);
|
||||
d = $urandom_range(0,5);
|
||||
a = $urandom_range(1,5);
|
||||
sf = $urandom_range(0,1);
|
||||
|
||||
$display("");
|
||||
$display(
|
||||
"--- TEST %0d --- n=%0d delay=%0d ack=%0d sf=%0b",
|
||||
i, n, d, a, sf
|
||||
);
|
||||
|
||||
run_test_case(
|
||||
n,
|
||||
d,
|
||||
a,
|
||||
sf,
|
||||
1, // random data
|
||||
1 // random out_of_range
|
||||
);
|
||||
|
||||
end
|
||||
|
||||
end
|
||||
endtask
|
||||
|
||||
// =====================================================
|
||||
// MAIN
|
||||
// =====================================================
|
||||
|
||||
initial begin
|
||||
|
||||
wait(!rst);
|
||||
|
||||
$display("");
|
||||
$display("=== BASIC TEST ===");
|
||||
|
||||
run_test_case(
|
||||
10,
|
||||
2,
|
||||
2,
|
||||
1,
|
||||
0,
|
||||
0
|
||||
);
|
||||
|
||||
$display("");
|
||||
$display("=== OUT_OF_RANGE TEST ===");
|
||||
|
||||
run_test_case(
|
||||
20,
|
||||
1,
|
||||
2,
|
||||
1,
|
||||
1,
|
||||
1
|
||||
);
|
||||
|
||||
$display("");
|
||||
$display("=== RANDOM STRESS TEST ===");
|
||||
|
||||
random_stress_test();
|
||||
|
||||
$display("");
|
||||
$display("=== TEST FINISHED ===");
|
||||
|
||||
$finish;
|
||||
|
||||
end
|
||||
|
||||
endmodule
|
||||
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